| 基于Innovus改善芯片繞線資源的電源網絡布線方法 | |
| 所屬分類：技術論文 | |
| 上傳者：wwei | |
| 文檔大?。?span>4163 K | |
| 標簽： 物理設計 單元密度 電源規(guī)劃 | |
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| 文檔介紹：隨著集成電路的集成度越來越高，芯片的面積越來越小，芯片內單元密度會隨之增加，這將為芯片的后端物理設計帶來諸多的挑戰(zhàn)。其中芯片面積的減小直接影響布線資源，導致布線擁塞，以此造成芯片線路無法繞通以及時序和串擾的問題。提出了一種改進的電源網絡的布線方法，極大提升了信號線的走線空間利用率，有效解決了高集成度芯片的短路問題。 | |
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